對電磁干擾的設計我們主要從硬件和軟件方面進行設計處理，下面就是從單片機的PCB設計到軟件處理方面來介紹對電磁兼容性的處理。
一、影響EMC的因數
1.電壓
電源電壓越高，意味著電壓振幅越大，發(fā)射就更多，而低電源電壓影響敏感度。
2.頻率
高頻產生更多的發(fā)射，周期性信號產生更多的發(fā)射。在高頻單片機系統中，當器件開關時產生電流尖峰信號;在模擬系統中，當負載電流變化時產生電流尖峰信號。
3.接地
在所有EMC題目中，主要題目是不適當的接地引起的。有三種信號接地方法：單點、多點和混合。在頻率低于1MHz時，可采用單點接地方法，但不適宜高頻;在高頻應用中，最好采用多點接地。混合接地是低頻用單點接地，而高頻用多點接地的方法。地線布局是關鍵，高頻數字電路和低電平模擬電路的接地電路盡不能混合。
4.PCB設計
適當的印刷電路板(PCB)布線對防止EMI是至關重要的。
5.電源往耦
當器件開關時，在電源線上會產生瞬態(tài)電流，必須衰減和濾掉這些瞬態(tài)電流。來自高di/dt源的瞬態(tài)電流導致地和線跡“發(fā)射”電壓，高di/dt產生大范圍的高頻電流，激勵部件和線纜輻射。流經導線的電流變化和電感會導致壓降，減小電感或電流隨時間的變化可使該壓降最小。
二、對干擾措施的硬件處理方法
1.印刷線路板(PCB)的電磁兼容性設計
PCB是單片機系統中電路元件和器件的支撐件，它提供電路元件和器件之間的電氣連接。隨著電子技術的飛速發(fā)展，PCB的密度越來越高。PCB設計的好壞對單片機系統的電磁兼容性影響很大，實踐證實，即使電路原理圖設計正確，印刷電路板設計不當，也會對單片機系統的可靠性產生不利影響。例如，假如印刷電路板的兩條細平行線靠的很近，會形成信號波形的延遲，在傳輸線的終端形成反射噪聲。因此，在設計印刷電路板的時候，應留意采用正確的方法，遵守PCB設計的一般原則，并應符合抗干擾的設計要求。要使電子電路獲得最佳性能，元器件的布局及導線的布設是很重要的。
2.輸入/輸出的電磁兼容性設計
在單片機系統中輸進/輸出也是干擾源的傳導線，和接收射頻干擾信號的拾檢源，我們設計時一般要采取有效的措施：
①采用必要的共模/差模抑制電路，同時也要采取一定的濾波和防電磁屏蔽措施以減小干擾的進進。
②在條件許可的情況下盡可能采取各種隔離措施(如光電隔離或者磁電隔離)，從而阻斷干擾的傳播。
3.單片機復位電路的設計
在的單片機系統中，看門狗系統對整個單片機的運行起著特別重要的作用，由于所有的干擾源不可能全部被隔離或往除，一旦進進CPU干擾程序的正常運行，那么復位系統結合軟件處理措施就成了一道有效的糾錯防御的屏障了。常用的復位系統有以下兩種：
①外部復位系統。外部“看門狗”電路可以自己設計也可以用專門的“看門狗”芯片來搭建。然而，他們各有優(yōu)缺點，大部分專用“看門狗”芯片對低頻“喂狗”信號不能響應，而高頻“喂狗”信號都能響應，使其在低頻“喂狗”信號下產生復位動作而在高頻的“喂狗”信號下不產生復位動作，這樣，假如程序系統陷進一個死循環(huán)，而該循環(huán)中恰巧有著“喂狗”信號的話，那么該復位電路就無法實現它的應有的功能了。然而，我們自己可以設計一個具有帶通的“喂狗”電路和其他復位電路構成的系統就是一個很有效外部監(jiān)控系統了。
②現在越來越多的單片機都帶有自己的片上復位系統，這樣用戶就可以很方便的使用其內部的復位定時器了，但是，有一些型號的單片機它的復位指令太過于簡單，這樣也會存在象上述死循環(huán)那樣的“喂狗”指令，使其失往監(jiān)控作用。有一些單片機的片上復位指令就做的比較好，一般他們把“喂狗”信號做成固定格式的多條指令依順序來執(zhí)行，假如有一定錯誤則該“喂狗”操縱無效，這樣就大大進步了復位電路的可靠性。
4.振蕩器
大部分的單片機都有一個耦合于外部晶體或陶瓷諧振器的振蕩器電路。在PCB上，要求外接是電容、晶體或陶瓷諧振器的引線越短越好。RC振蕩器對干擾信號有潛伏的敏感性，它能產生很短的時鐘周期，因而最好選晶體或陶瓷諧振器。另外，石英晶體的外殼要接地。
5.防雷擊措施
室外使用的單片機系統或從室外排擠引進室內的電源線、信號線，要考慮系統的防雷擊題目。常用的防雷擊器件有：氣體放電管、TVS(Transient Voltage Suppression)等。氣體放電管是當電源的電壓大于某一數值時，通常為數十V或數百V，氣體擊穿放電，將電源線上強沖擊脈沖導進大地。TVS可以看成兩個并聯且方向相反的齊納二極管，當兩端電壓高于某一值時導通。其特點是可以瞬態(tài)通過數百乃上千A的電流。
三、對干擾措施的軟件處理方法
電磁干擾源所產生的干擾信號在一些特定的情況下(比如在一些電磁環(huán)境比較惡劣的情況下)是無法完全消除的，終極將會進進CPU處理的的核心單元，這樣在一些大規(guī)模集成電路經常會受到干擾，導致不能正常工作或在錯誤狀態(tài)下工作。特別是像RAM這種利用雙穩(wěn)態(tài)進行存儲的器件，往往會在強干擾下發(fā)生翻轉，使原來存儲的“0”變?yōu)?ldquo;1”，或者“1”變?yōu)?/div>
“0”;一些串行傳輸的時序及數據會因干擾而發(fā)生改變;更嚴重的會破壞一些重要的數據參數等;造成的后果往往是很嚴重的。在這種情況下軟件設計的好壞直接影響到整個系統的抗干擾能力的高低。
1.程序會由于電磁干擾大致會一下幾種情況：
①程序跑飛。
這種情況是最常見的干擾結果，一般來說有一個好的復位系統或軟件幀測系統即可，對整個運行系統的不會產生太大的影響。
②死循環(huán)或不正常程序代碼運行。
當然這種死循環(huán)和不正常程序代碼并非設計職員有意寫進的，我們知道程序的指令是由字節(jié)組成的，有的是單字節(jié)指令而有的是多字節(jié)指令，當干擾產生后使得PC指針發(fā)生變化，從而使原來的程序代碼發(fā)生了重組產生了不可猜測的可執(zhí)行的程序代碼，那么，這種錯誤是致命的，它會有可能會往修改重要的數據參數，有可能產生不可猜測的控制輸出等一系列錯誤狀態(tài)。
2.對重要參數儲存的措施
一般情況下，我們可以采用錯誤檢測與糾正來有效地減少或避免這種情況的出現。根據檢錯、糾錯的原理，主要思想是在數據寫進時，根據寫進的數據天生一定位數的校驗碼，與相應的數據一起保存起來;當讀出時，同時也將校驗碼讀出，進行判決。假如出現一位錯誤則自動糾正，將正確的數據送出，并同時將改正以后的數據回寫覆蓋原來錯誤的數據;假如出現兩位錯誤則產生中斷報告，通知CPU進行異常處理。所有這一切動作都是靠軟件設計自動完成的，具有實時性和自動完成的特點。通過這樣的設計，能大大進步系統的抗干擾能力，從而進步系統的可靠性。
檢錯與糾錯原理：
首先來看看檢錯和糾錯的基本原理。進行差錯控制的基本思想是在信息碼組中以一定規(guī)則加進不同方式的冗余碼，以便在信息讀出的時候依靠多余的監(jiān)視碼或校碼碼來發(fā)現或自動糾正錯誤。
針對誤碼發(fā)生的特點，即錯誤發(fā)生的隨機性和小概任性，它幾乎總是隨機地影響某個字節(jié)中的某一位(bit)，因此，假如能夠設計自動糾正一位錯誤，而檢查兩位錯誤的編碼方式。就可以大大進步系統的可靠性。
3.對RAM和FLASH(ROM)的檢測
在編制程序時我們最好是寫進一些檢測程序來測試RAM和FLASH(ROM)的數據代碼，看有無發(fā)生錯誤，一旦發(fā)生要立即糾正，糾正不了的要及時給出錯誤指示，以便用戶往處理。
另外，在編制程序時加進程序冗余是不可缺少的。在一定的地方加進三條或三條以上NOP指令對程序的重組有著很有效防止作用。同時，在程序的運行狀態(tài)中要引進標志數據和檢測狀態(tài)，從而及時發(fā)現和糾正錯誤產生。
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